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Titel |
TI |
[DE] Lateraler Trenchtransistor sowie Verfahren zur Herstellung desselben
[EN] Lateral trench transistor has body region inside which a semiconductor region is provided which is electrically connected with source contact and its type of endowment corresponds to the type of endowment of body region |
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Anmelder/Inhaber |
PA |
Infineon Technologies AG, 81669 München, DE
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| 72 |
Erfinder |
IN |
Hirler, Franz, Dr., 84424 Isen, DE
;
Meyer, Thorsten, Dr., 81545 München, DE
;
Rüb, Michael, Dr., Faak am See, AT
;
Schmitt, Markus, 81373 München, DE
;
Schäffer, Carsten, Sattendorf, AT
;
Tolksdorf, Carolin, 82327 Tutzing, DE
;
Wahl, Uwe, Dr.-Ing., 80798 München, DE
;
Willmeroth, Armin, 86163 Augsburg, DE
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| 22/96 |
Anmeldedatum |
AD |
29.10.2004 |
| 21 |
Anmeldenummer |
AN |
102004052643 |
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Anmeldeland |
AC |
DE |
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Veröffentlichungsdatum |
PUB |
04.05.2006 |
33
31
32 |
Priorität |
PRC
PRN
PRD |
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| 51 |
IPC-Hauptklasse |
ICM |
H01L 29/78
(2006.01)
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| 51 |
IPC-Nebenklasse |
ICS |
H01L 21/336
(2006.01)
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IPC-Zusatzklasse |
ICA |
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IPC-Indexklasse |
ICI |
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Gemeinsame Patentklassifikation |
CPC |
H01L 21/26586
H01L 29/0696
H01L 29/1045
H01L 29/1095
H01L 29/41758
H01L 29/4236
H01L 29/42368
H01L 29/66666
H01L 29/66689
H01L 29/66704
H01L 29/78
H01L 29/7825
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MCD-Hauptklasse |
MCM |
H01L 29/78
(2006.01)
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MCD-Nebenklasse |
MCS |
H01L 21/336
(2006.01)
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MCD-Zusatzklasse |
MCA |
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Zusammenfassung |
AB |
[DE] Ein lateraler Trenchtransistor (1) weist einen Halbleiterkörper (2) auf, in dem ein Sourcegebiet (3) und ein Bodygebiet (4), die durch einen Sourcekontakt (12) kontaktiert werden, ein Draingebiet (5), das durch einen Drainkontakt (15) kontaktiert wird, und einen Gatetrench (6), in dem eine gegenüber dem Halbleiterkörper (2) isolierte Gateelektrode (7) eingebettet ist, vorgesehen sind. Innerhalb des Bodygebiets (4) bzw. daran angrenzend ist ein hochdotiertes Halbleitergebiet (10) vorgesehen, das mit dem Sourcekontakt (12) elektrisch verbunden ist und dessen Dotiertyp dem des Bodygebiets (4) entspricht.
[EN] Lateral trench transistor (200) has a body region (4) inside which a semiconductor region (10) is provided adjoining to it. The semiconductor region is electrically connected with the source contact (12) and its type of endowment corresponds to the type of endowment of body region. An independent claim is also included for a method for manufacturing of endowed semiconductor region. |
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Entgegengehaltene Patentdokumente/Zitate,
in Recherche ermittelt |
CT |
DE000019742342A1
DE000010210138A1
DE000010358697A1
DE000019743342C2
DE000019818300C1
EP000001094525A2
US000003975221A
US020020099922A1
US020040014263A1
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| 56 |
Entgegengehaltene Patentdokumente/Zitate,
vom Anmelder genannt |
CT |
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Entgegengehaltene Nichtpatentliteratur/Zitate,
in Recherche ermittelt |
CTNP |
Sakakibara et al: Break-through of the Si Limit under 300 V breakdown voltage with new concept power device: Super 3D MOSFET. In: ISPSD 2002, 2002, S233 - 236. n;
Yamaguchi et al: Ultra Low ON-resistance Super 3D MOSFET. In: ISPSD 2003, 2003, S. 319 - 319. n
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| 56 |
Entgegengehaltene Nichtpatentliteratur/Zitate,
vom Anmelder genannt |
CTNP |
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Zitierende Dokumente |
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Dokumente ermitteln
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Sequenzprotokoll |
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Prüfstoff-IPC |
ICP |
H01L 21/336
H01L 29/06
H01L 29/10
H01L 29/417
H01L 29/423
H01L 29/739
H01L 29/78
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